一块搭载了英伟达N1X处理器的惠普开发板（HP 83A3）在Geekbench上亮相。在Geekbench的测试中，运行Linux（Ubuntu 24.04.1）的N1X处理器在单核测试中获得了3096分，在多核测试中获得了18837分，平均频率为4GHz。数据显示这款处理器为20线程配置，由于Arm通常没有像英特尔那样的超线程技术，因此很可能是20个物理核心，类似于英伟达迷你超算所搭载的GB10。同时，该开发板可能配备128GB系统内存，其中8GB预留给GPU。其性能已经接近甚至超过了当前市场上的一些顶
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英伟达 Arm PC 芯片 SoC 处理器 联发科
全球领先的嵌入式软件解决方案供应商IAR正式发布其旗舰产品的重大更新版本：Arm开发工具链v9.70和RISC-V开发工具链v3.40，大幅提升了IAR开发平台在性能、安全性和自动化方面的能力，助力汽车、工业、医疗和物联网等行业中的敏捷、可扩展嵌入式应用。为应对嵌入式系统日益增长的复杂性，全新的IAR开发工具链支持云端许可、CI/CD管道集成和多种架构的开发。随着Arm和RISC-V持续推动技术演进，IAR推出统一的开发平台，提供高质量且具安全保障的开发体验。新版本帮助客户提升研发效率、降低研发成本、缩短
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IAR RISC-V
当夕阳的余晖透过 1950 年纽约的玻璃窗，洒在阿西莫夫伏案疾书的稿纸上。在发表《我，机器人》的那个遥远的下午，这位科幻巨匠或许未曾料到，自己笔下那些拥有自我意识的机器人，正以另一种形态叩击着人类文明的边界。「智能眼镜，将会是远超 VR 的产品。」Meta 创始人扎克伯格在日前的一次访谈中笃定。Meta 的一季度财报也证实了扎克伯格的观点，公司表示 Ray-Ban Meta AI 眼镜月活跃用户是一年前的 4 倍多。一场关于人机交互的革命，在镜片的方寸之间展开。等待一阵风AI 眼镜的火
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SoC
据《光明日报》报道，由北京航空航天大学（Beijing Aeronautics University，BUAA）电子与信息工程学院李洪革教授领导的研究团队成功开发了一款开创性的计算芯片——混合随机计算 SoC 芯片。该芯片基于完全自主研发的开源 RISC-V 架构，容错能力强、抗干扰能力强、能效高。它引入了数字表示（重新定义二进制数）、计算算法（内存计算）和异构计算架构（SoC 设计）的颠覆性创新。这一成就建立了基于混合随机数的新计算范式，代表了从数值系统表示到芯片实现的原创创新，支撑了中国高性能智能计算
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BUAA 混合随机计算 SoC 北航
英国芯片设计公司 Aion Silicon（前身为 Sondrel）赢得了一个 $12m 的项目，用于开发用于高性能计算 （HPC） 和人工智能 （AI） 应用的 RISC-V 加速器。该项目涵盖了从完整的 RTL 架构和验证到可测试设计、物理实现和使用 RISC-V 开放指令集架构 （ISA） 和矢量扩展在前沿节点上流片的所有设计工作，以加速 AI 工作负载。Aion 已经从设计服务（例如最近的视频芯片 ASIC 合同）转变为提供全方位服务的芯片供应，包括与代工厂合作。它之前曾为“全球 HPC 竞赛需要
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Aion Silicon RISC-V AI芯片
近日，全球领先的连接和电源解决方案供应商 Qorvo®（纳斯达克代码：QRVO）宣布拓展其QPG6200产品组合，全新推出三款Matter系统级芯片（SoC）。此次扩展的产品系列具有超低的功耗，并采用Qorvo独有的ConcurrentConnect™技术，可为智能家居、工业自动化和物联网市场提供强大的多协议支持功能和无缝互操作性。 这三款全新的SoC与此前发布的QPG6200L SoC同属QPG6200产品家族，QPG6200L目前已与多家领先的智能家居OEM厂商合作量产，通过采用高能效架构和
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Qorvo Matter SoC
提到服务器 CPU 芯片，X86 和 ARM 架构是大众认知中的「常客」。而最近，随着一系列热点事件的发布，基于 RISC-V 架构的服务器 CPU 迅速 「破圈」，闯入大众视野。RISC-V 服务器 CPU，纷纷亮相RISC-V 架构有着开源、指令精简和可扩展的优势，在注重能效比的物联网领域收获颇丰。不过，这并不意味着 RISC-V 无法进军有更高性能要求的 PC 和服务器市场。如今，已有多家公司的 RISC-V 架构服务器 CPU 芯片亮相。玄铁C930阿里巴巴达摩院旗下品牌玄铁，
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RISC-V 服务器CPU
小米最近在宣布其自主开发的智能手机 SoC 芯片 XRING 01 后引起了广泛关注。据中国媒体《明报》报道，小米首席执行官雷军 5 月 19 日在微博上透露，该芯片采用 3nm 工艺制造，这标志着中国公司首次成功实现 3nm 芯片设计的突破。这家中国科技巨头正在加大其芯片开发力度。据《华尔街日报》报道，小米计划在至少 10 年内投资近 70 亿美元用于芯片设计。创始人兼首席执行官雷军周一在微博上发文透露了这一投资数字。报告指出，小米发言人补充说，这项 500 亿元人民币（相当于 69.4 亿美元）的投资
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小米 3nm SoC
5月19日，雷军微博宣布小米自主研发设计的3nm制程手机处理器芯片玄戒O1即将亮相。小米将成为继苹果、高通、联发科后，全球第四家发布自主研发设计3nm制程手机处理器芯片的企业。回顾了小米第一代自研手机SoC“澎湃S1”的失败经历，从2014年9月立项，到2017年正式发布，“因为种种原因，遭遇挫折”，暂停了SoC大芯片的研发，转向了“小芯片”路线。包含了快充芯片、电池管理芯片、影像芯片、天线增强芯片等“小芯片”，在不同技术赛道中慢慢积累经验和能力。直到2021年初，小米宣布造车的同时，还在内部重启“大芯片
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小米 玄戒 3nm SoC 芯片
继华为和联想在中国开发自主开发的芯片之后，小米正在开发自己的玄戒XRing 01 SoC。据报道，这款新芯片采用标准 Arm Cortex 内核和台积电的 3nm 级工艺节点。根据HXL的说法，XRing 01具有强大的十核配置，并且根据泄密者 Jukanlosreve 分享的现已下架的芯片 Geekbench 测试，小米的替代品似乎提供了与联发科旗舰天玑 9400 SoC 相当的性能。面对来自美国的重大限制，并且与高通和联发科等其他公司相比，中国制造商可能节省成本，因此正在迅速过渡到
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小米 玄戒01 SoC Arm Cortex Mali G925 GPU
5月15日晚间，小米集团创始人雷军发布微博称，小米自主研发设计的手机SoC芯片名字叫“玄戒O1”，将在5月下旬发布。这不是小米第一次尝试芯片自研，早在2017年就有推出过澎湃 S1。这次玄戒芯片的回归，不仅是一次技术层面的补位，更像是小米正式向“高端自主可控”阵营迈出的一步。自研芯片不仅是技术竞赛，更是对产业链话语权的争夺，若玄戒能站稳脚跟，国产手机厂商或将迎来从「组装创新」到「底层定义」的质变 —— 比如供应链自主可控、软硬协同优化、国产技术链反哺等，或将吸引OPPO、vivo等厂商加速自研芯片投入，进
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小米 手机 SoC 芯片
芬兰的 Flow Computing 已开始对其并行处理单元 （PPU） AI 模块的 RISC-V 编译器进行 alpha 测试。PPU 能够通过使用编译器使源代码利用该架构，将任何 CPU 架构增加多达 100 倍。第一次目标编译表明，通过重新编译现有代码，可以显著减少 RISC-V CPU 模型中常见的循环，达到 100 倍的预期性能。相比之下，只需将一些 CPU 内核替换为 PPU，即可在不更改源代码的情况下进行 2 倍的改进，而无需重新编译。编译器识别现有源代码中可由 PPU 有效加速的并行元素
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并行AI RISC-V 编译器 Alpha测试
西班牙的 SemiDynamics 开发了一种完全可编程的神经处理单元 （NPU） IP，它结合了 CPU、向量和张量处理，可为大型语言模型和 AI 推荐系统提供高达 256 TOPS 的吞吐量。Cervell NPU 基于 RISC-V 开放指令集架构，可从 8 个内核扩展到 64 个内核。这使设计人员能够根据应用的要求调整性能，从紧凑型边缘部署中 1GHz 的 8 TOPS INT8 到数据中心芯片中高端 AI 推理中的 256 TOPS INT4。这是继 12 月推出的一体化架构之后发布的，本白皮书
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SemiDynamics RISC-V NPU
据外媒WCCFtech报道，小米旗下芯片部门玄戒「Xring」已独立运营，团队规模达1000人，由高通前资深总监秦牧云领导。有消息传出，小米已完成首款3nm工艺SoC原型测试，进入设计定案（tape out），预计会在今年发布。但该芯片将采用Arm现有的设计架构，而非使用任何小米自研核心。根据代码提交记录及供应链消息，玄戒芯片的硬件架构已逐渐清晰，其采用“1+3+4”八核三丛集设计：采用1颗Cortex-X3超大核（主频3.2GHz）、3颗Cortex-A715中核（主频2.6GHz）、4颗Cortex-
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小米 芯片 自研 玄戒 Xring SoC Arm
4月15~17日，沁恒多维度、多层次的USB/Type-C/蓝牙/以太网接口芯片和青稞RISC-V系列MCU/SoC亮相2025上海慕尼黑电子展，现场人气火爆。RISC-V全家桶、Type-C全家桶等特色版块，工业控制、物联网、计算机手机周边等场景专题，9大版面充分诠释了沁恒对专业RISC-V玩家的定义：技术上一捅到底、产品上百花齐放，应用上互连互通。一捅到底的技术处理器“核”技术是数据处理的关键，接口底层PHY“根”技术是信息交换的窗口。秉承由核到芯、由内而外的全栈自研模式，沁恒青稞RISC-V贯穿了内
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